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fix: support riscv32 build
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9c95cb4f5e
16
build.rs
16
build.rs
@ -1,18 +1,24 @@
|
||||
fn main() {
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||||
println!("cargo:rerun-if-changed=build.rs");
|
||||
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||||
struct TargetConfiguration {
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struct TargetConfig {
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||||
target: &'static str,
|
||||
lds: &'static str,
|
||||
}
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||||
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const TARGET_CONFIGURATIONS: &[TargetConfiguration] = &[TargetConfiguration {
|
||||
const TARGET_LDS: &[TargetConfig] = &[
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||||
TargetConfig {
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target: "riscv64",
|
||||
lds: "src/arch/riscv/linker64.ld",
|
||||
}];
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||||
lds: "src/arch/riscv/linker.ld",
|
||||
},
|
||||
TargetConfig {
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||||
target: "riscv32",
|
||||
lds: "src/arch/riscv/linker.ld",
|
||||
},
|
||||
];
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||||
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||||
let target = std::env::var("TARGET").unwrap();
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||||
for cfg in TARGET_CONFIGURATIONS {
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||||
for cfg in TARGET_LDS {
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||||
if target.starts_with(cfg.target) {
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||||
println!("cargo:rerun-if-changed={}", cfg.lds);
|
||||
println!("cargo:rustc-link-arg=-T{}", cfg.lds);
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||||
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@ -12,53 +12,53 @@ __user2kernel:
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||||
li a0, {TRAPFRAME} # TRAPFRAME will be mapped to the same virtual address
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||||
# save GPRs
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sd ra, 0(a0)
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||||
sd sp, 4(a0)
|
||||
sd gp, 8(a0)
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||||
sd tp, 12(a0)
|
||||
sd t0, 16(a0)
|
||||
sd t1, 20(a0)
|
||||
sd t2, 24(a0)
|
||||
sd s0, 28(a0)
|
||||
sd s1, 32(a0)
|
||||
#sd a0, 36(a0)
|
||||
sd a1, 40(a0)
|
||||
sd a2, 44(a0)
|
||||
sd a3, 48(a0)
|
||||
sd a4, 52(a0)
|
||||
sd a5, 56(a0)
|
||||
sd a6, 60(a0)
|
||||
sd a7, 64(a0)
|
||||
sd s2, 68(a0)
|
||||
sd s3, 72(a0)
|
||||
sd s4, 76(a0)
|
||||
sd s5, 80(a0)
|
||||
sd s6, 84(a0)
|
||||
sd s7, 88(a0)
|
||||
sd s8, 92(a0)
|
||||
sd s9, 96(a0)
|
||||
sd s10, 100(a0)
|
||||
sd s11, 104(a0)
|
||||
sd t3, 108(a0)
|
||||
sd t4, 112(a0)
|
||||
sd t5, 116(a0)
|
||||
sd t6, 120(a0)
|
||||
sw ra, 0(a0)
|
||||
sw sp, 4(a0)
|
||||
sw gp, 8(a0)
|
||||
sw tp, 12(a0)
|
||||
sw t0, 16(a0)
|
||||
sw t1, 20(a0)
|
||||
sw t2, 24(a0)
|
||||
sw s0, 28(a0)
|
||||
sw s1, 32(a0)
|
||||
#sw a0, 36(a0)
|
||||
sw a1, 40(a0)
|
||||
sw a2, 44(a0)
|
||||
sw a3, 48(a0)
|
||||
sw a4, 52(a0)
|
||||
sw a5, 56(a0)
|
||||
sw a6, 60(a0)
|
||||
sw a7, 64(a0)
|
||||
sw s2, 68(a0)
|
||||
sw s3, 72(a0)
|
||||
sw s4, 76(a0)
|
||||
sw s5, 80(a0)
|
||||
sw s6, 84(a0)
|
||||
sw s7, 88(a0)
|
||||
sw s8, 92(a0)
|
||||
sw s9, 96(a0)
|
||||
sw s10, 100(a0)
|
||||
sw s11, 104(a0)
|
||||
sw t3, 108(a0)
|
||||
sw t4, 112(a0)
|
||||
sw t5, 116(a0)
|
||||
sw t6, 120(a0)
|
||||
|
||||
# save a0
|
||||
csrr t0, sscratch
|
||||
sd t0, 36(a0)
|
||||
sw t0, 36(a0)
|
||||
|
||||
# save user epc / sstatus
|
||||
csrr t0, sepc
|
||||
csrr t1, sstatus
|
||||
sd t0, 124(a0)
|
||||
sd t1, 128(a0)
|
||||
sw t0, 124(a0)
|
||||
sw t1, 128(a0)
|
||||
|
||||
# restore kernel env
|
||||
ld sp, 132(a0) # kernel sp
|
||||
ld tp, 136(a0) # kernel tp
|
||||
ld t0, 140(a0) # trap handler
|
||||
ld t1, 144(a0) # page table
|
||||
lw sp, 132(a0) # kernel sp
|
||||
lw tp, 136(a0) # kernel tp
|
||||
lw t0, 140(a0) # trap handler
|
||||
lw t1, 144(a0) # page table
|
||||
|
||||
# load kernel page table
|
||||
sfence.vma zero, zero
|
||||
@ -78,44 +78,44 @@ __kernel2user:
|
||||
li a0, {TRAPFRAME}
|
||||
|
||||
# restore user epc / sstatus
|
||||
ld t0, 124(a0)
|
||||
ld t1, 128(a0)
|
||||
lw t0, 124(a0)
|
||||
lw t1, 128(a0)
|
||||
csrw sepc, t0
|
||||
csrw sstatus, t1
|
||||
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||||
# restore GPRs
|
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ld ra, 0(a0)
|
||||
ld sp, 4(a0)
|
||||
ld gp, 8(a0)
|
||||
ld tp, 12(a0)
|
||||
ld t0, 16(a0)
|
||||
ld t1, 20(a0)
|
||||
ld t2, 24(a0)
|
||||
ld s0, 28(a0)
|
||||
ld s1, 32(a0)
|
||||
#ld a0, 36(a0)
|
||||
ld a1, 40(a0)
|
||||
ld a2, 44(a0)
|
||||
ld a3, 48(a0)
|
||||
ld a4, 52(a0)
|
||||
ld a5, 56(a0)
|
||||
ld a6, 60(a0)
|
||||
ld a7, 64(a0)
|
||||
ld s2, 68(a0)
|
||||
ld s3, 72(a0)
|
||||
ld s4, 76(a0)
|
||||
ld s5, 80(a0)
|
||||
ld s6, 84(a0)
|
||||
ld s7, 88(a0)
|
||||
ld s8, 92(a0)
|
||||
ld s9, 96(a0)
|
||||
ld s10, 100(a0)
|
||||
ld s11, 104(a0)
|
||||
ld t3, 108(a0)
|
||||
ld t4, 112(a0)
|
||||
ld t5, 116(a0)
|
||||
ld t6, 120(a0)
|
||||
ld a0, 36(a0)
|
||||
lw ra, 0(a0)
|
||||
lw sp, 4(a0)
|
||||
lw gp, 8(a0)
|
||||
lw tp, 12(a0)
|
||||
lw t0, 16(a0)
|
||||
lw t1, 20(a0)
|
||||
lw t2, 24(a0)
|
||||
lw s0, 28(a0)
|
||||
lw s1, 32(a0)
|
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#lw a0, 36(a0)
|
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lw a1, 40(a0)
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lw a2, 44(a0)
|
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lw a3, 48(a0)
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lw a4, 52(a0)
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lw a5, 56(a0)
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lw a6, 60(a0)
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lw a7, 64(a0)
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lw s2, 68(a0)
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lw s3, 72(a0)
|
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lw s4, 76(a0)
|
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lw s5, 80(a0)
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lw s6, 84(a0)
|
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lw s7, 88(a0)
|
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lw s8, 92(a0)
|
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lw s9, 96(a0)
|
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lw s10, 100(a0)
|
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lw s11, 104(a0)
|
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lw t3, 108(a0)
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lw t4, 112(a0)
|
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lw t5, 116(a0)
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lw t6, 120(a0)
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lw a0, 36(a0)
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# go back to usermode
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sret
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